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超级简历
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工作经历
XX有限公司
2012年10月
-
2019年10月
FPGA开发工程师
- 负责 5G TUE 物理层通信链路开发方案制定,负责FPGA 相关代码开发及调试,与其它子系统进行联调、故障排查等工作。
- 参与项目主要为与 5G 基站对接的 UE 相关开发,FPGA 负责上下行物理层协议的实现。
- 该项目使用 Xilinx VU9P 芯片,使用 Modelsim 和 Verdi 仿真, Vivado 编译版本。使用 Verilog 语言进行代码开发。
XX有限公司
2005年08月
-
2012年09月
FPGA开发工程师
- 参与项目设计讨论,制定符合项目要求的测试计划,指出项目在FPGA验证过程中可能发生的问题以及解决方案。
- 按照项目要求,将ASIC Designer的RTL源代码转变成适合FPGA芯片所支持的RTL代码,然后在SOC仿真环境中将FPGA的修改点集成到SOC环境中做进行整体的功能仿真。在仿真完成后,将RTL代码进行综合和编译并添加时序约束后,再生成网表文件。经过初步测试后再给ChipDriver人员进行各种功能模块验证。根据ChipDriver人员测试结果,定位测试中碰到的各种问题,然后重新修改RTL代码后再重复上述步骤后进行测试,直至测试无误为止。在项目测试结束后,给出项目的验证文档和测试报告,进行文档的总结和归档。
- 参与过多个项目的验证测试,包括ROC1/Whale2/iWhale2/WhaleK/NemoG/SharkLJ1/SharkLE/Marlin3E/Adie等手机基带芯片的功能验证。
教育经历
扬州大学
2001年09月
-
2005年07月
电子信息工程
本科
扬州
其他
- 语言: 普通话二级甲等证书
- 技能: Soc,Word,Fpga,Excel,仿真,Verilog,Designer,办公软件,电子信息工程
项目经历
某项目
2018年03月
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2018年06月
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下行业务 FPGA 在 PDSCH 信道负责对中射频 FPGA 送出的数字信号进行处理,主要处理过程包括频偏纠正、去除 CP、 FFT 处理、时偏补偿、有效数据抽取、 AXC 格式转换等,将数据发送给 DSP 做进一步处理;
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做完上述处理之后,继续进行信道估计、信道均衡、 Polar 译码、 RNTI 校验等处理;
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负责TUE FPGA下行时频域链路的开发仿真、联合调试等工作;TUE FPGA PDCCH链路的开发仿真及debug等工作;相关FPGA开发方案、调试方法等文档的设计、撰写工作





