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妙芯微(Agiband)成立于2023年,是一家聚焦AI互联的新锐芯片科创企业。核心团队成员均来自全球顶尖通信网络芯片公司,深耕高端互联芯片领域。公司秉持“以网强算”核心理念,专注带宽提升、架构革新与生态开放,主营业务涵盖算力/存力芯片全生命周期互联解决方案和定制化互联芯片Turn-key交付。
妙芯微(Agiband)成立于2023年,是一家聚焦AI互联的新锐芯片科创企业。核心团队成员均来自全球顶尖通信网络芯片公司,深耕高端互联芯片领域。公司秉持“以网强算”核心理念,专注带宽提升、架构革新与生态开放,主营业务涵盖算力/存力芯片全生命周期互联解决方案和定制化互联芯片Turn-key交付。
培养政策:一对一专属带教,量身定制学习计划,手把手掌握IC设计、验证、FPGA开发等专业技能。
薪资福利:高薪薪资、多重补贴、完整福利体系、规范假期制度。
工作氛围:全员深耕技术、专注研发,氛围纯粹务实,远离职场内耗。
发展前景:直接参与主力AI互联芯片研发项目,表现优异者可获优先转正。
参与AI互联IP的微架构设计及RTL实现(Verilog/SystemVerilog)。
负责核心模块(数据路径、缓冲区管理、流量控制等)的设计开发。
协助完成前端设计全流程:逻辑综合、时序分析(STA)、跨时钟域(CDC)处理。
规范撰写设计文档,协同验证/FPGA/后端团队迭代。
参与AI辅助开发流程优化。
基于UVM方法学,搭建、维护模块级/系统级验证环境。
独立开发测试用例、执行仿真、调试问题,保障功能覆盖率达标。
编写自动化测试脚本,优化验证流程。
参与AI辅助验证方案迭代与流程优化。
配合研发团队定位并解决验证问题。
参与FPGA Emulation验证方案的设计、落地与调试。
负责Emulation测试平台搭建、运维与流程优化。
使用Verilog HDL完成FPGA测试代码开发与仿真验证。
协助系统总体方案设计,参与FPGA选型、数据流程梳理与架构设计。
制定标准化测试计划,负责上板调试、问题复盘与分析优化。
参与AI互联芯片配套驱动、SDK、测试工具开发与维护。
配合硬件/IC团队开展软硬件联调,定位并解决协同问题。
负责AI互联芯片配套硬件原理图、PCB设计及器件选型。
完成高速电路、电源、时钟设计,开展信号/电源完整性仿真。
对接智算中心、服务器客户,提供互联芯片/IP技术支持。
编写技术方案、应用手册,开展客户培训,跟进项目落地。
点击“立即投递”查看联系方式与投递方式。
参与AI互联IP的微架构设计及RTL实现,负责核心模块设计开发,协助前端设计全流程
基于UVM方法学搭建验证环境,开发测试用例,执行仿真调试,参与AI辅助验证方案优化
参与FPGA Emulation验证方案设计落地,负责测试平台搭建运维,使用Verilog HDL开发测试代码
参与AI互联芯片配套驱动、SDK、测试工具开发维护,配合软硬件联调
负责AI互联芯片配套硬件原理图、PCB设计及器件选型,完成高速电路设计
对接智算中心、服务器客户,提供互联芯片/IP技术支持,编写技术方案
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建议先优先匹配 IC设计工程师、硬件工程师、FPGA Emul工程师 等方向,把最相关的经历放到简历前半部分,避免一份简历同时覆盖过多差异较大的岗位。
岗位地点主要集中在 无锡市 / 苏州市 / 无锡、苏州。若你只接受部分城市,建议在投递前先确认目标岗位地点,避免进入流程后再因为城市不匹配放弃机会。
先核对自己的学历背景是否满足 本科 要求,再结合岗位关键词检查专业、项目或实习经历是否能形成直接支撑。
当前整理到的重点岗位方向包括 IC设计工程师、硬件工程师、FPGA Emul工程师。建议你先挑与你专业、项目经历最贴近的 1 到 2 个方向重点投递,不要把完全不同的岗位混在一套简历里海投;针对性地突出课程、项目和实习经历,会更容易通过初筛。
当前整理到的信息里,学历要求为 本科。如果你的专业、项目经历和岗位方向匹配,建议不要只因为描述较泛就放弃投递;但在正式投递前,仍要回到原始招聘说明确认是否有专业、毕业时间或英语要求。
当前页面整理出的重点城市包括 无锡市 / 苏州市 / 无锡、苏州。如果你只能接受少数城市,建议优先确认岗位地点是否固定、后续是否可能调剂,并在简历和面试里准备好你对目标城市的稳定性说明。
从当前岗位信息看,较值得突出的是 IC设计工程师、IC验证工程师、FPGA Emul工程师、系统软件工程师 相关经历。建议把最能证明你匹配度的课程项目、实习成果或竞赛经历放在前半屏,并尽量用结果化表述说明你做了什么、解决了什么问题、取得了什么产出。
对于 秋招 这类校招信息,建议先看 4 件事:岗位方向是否匹配、城市是否可接受、学历和毕业时间是否符合、投递截止时间是否紧张。如果这 4 项都大致匹配,再花时间优化简历和准备笔面试,投入产出会更高。
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